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Virtex-6 FPGA Data Sheet: DC and Switching Characteristics
Input Serializer/Deserializer Switching Characteristics
Table 51: ISERDES Switching Characteristics
Symbol
Description
-3
-2
Speed Grade
-1 (XC) -1 (XQ)
-1L
Units
Setup/Hold for Control Lines
T ISCCK_BITSLIP / T ISCKC_BITSLIP
T ISCCK_CE / T ISCKC_CE (2)
T ISCCK_CE2 / T ISCKC_CE2 (2)
BITSLIP pin Setup/Hold with respect to
CLKDIV
CE pin Setup/Hold with respect to CLK
(for CE1)
CE pin Setup/Hold with respect to CLKDIV
(for CE2)
0.07/
0.15
0.20/
0.03
0.01/
0.27
0.08/
0.16
0.25/
0.04
0.01
0.29
0.09/
0.17
0.27/
0.04
0.01/
0.31
0.09/
0.17
0.27/
0.04
0.01/
0.31
0.14/
0.17
0.31/
0.05
–0.05/
0.35
ns
ns
ns
Setup/Hold for Data Lines
T ISDCK_D /T ISCKD_D
T ISDCK_DDLY /T ISCKD_DDLY
T ISDCK_D_DDR /T ISCKD_D_DDR
T ISDCK_DDLY_DDR
T ISCKD_DDLY_DDR
D pin Setup/Hold with respect to CLK
DDLY pin Setup/Hold with respect to CLK
(using IODELAY) (1)
D pin Setup/Hold with respect to CLK at
DDR mode
D pin Setup/Hold with respect to CLK at
DDR mode (using IODELAY) (1)
0.07/
0.08
0.10/
0.05
0.07/
0.08
0.10/
0.05
0.08/
0.09
0.12/
0.06
0.08/
0.09
0.12/
0.06
0.09/
0.11
0.14/
0.07
0.09/
0.11
0.14/
0.07
0.09/
0.11
0.14/
0.07
0.09/
0.11
0.14/
0.07
0.11/
0.19
0.16/
0.15
0.11/
0.19
0.16/
0.15
ns
ns
ns
ns
Sequential Delays
T ISCKO_Q
CLKDIV to out at Q pin
0.57
0.66
0.75
0.80
0.88
ns
Propagation Delays
T ISDO_DO
D input to DO output pin
0.19
0.22
0.25
0.25
0.28
ns
Notes:
1.
2.
Recorded at 0 tap value.
T ISCCK_CE2 and T ISCKC_CE2 are reported as T ISCCK_CE /T ISCKC_CE in TRACE report.
DS152 (v3.6) March 18, 2014
Product Specification
www.xilinx.com
39
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